《高速PCB设计指南》高速PCB设计指南二

高速PCB设计指南 高速PCB设计指南之二 第一篇高密度(HD)电路的设计 本文介绍,许多人把芯片规模的BGA封装看作是由便携式电子产品所需的空间限制的 个可行的解决方案,它同时满足这些产品更高功能与性能的要求。为便携式产品的高密度 电路设计应该为装配工艺着想。 当为今天价值推动的市场开发电子产品时,性能与可靠性是最优先考虑的。为了在这个 市场上竞争,开发者还必须注重装配的效率,因为这样可以控制制造成本。电子产品的技术 进步和不断增长的复杂性正产生对更高密度电路制造方法的需求。当设计要求表面贴装、密 间距和向量封装的集成电路IC时,可能要求具有较细的线宽和较密间隔的更高密度电 路板。可是,展望未来,一些已经在供应微型旁路孔、序列组装电路板的公司正大量投资来 扩大能力。这些公司认识到便携式电子产品对更小封装的目前趋势。单是通信与个人计算产 品工业就足以领导全球的市场 高密度电子产品的开发者越来越受到几个因素的挑战:物理复杂元件上更密的引脚间 隔、财力贴装必须很精密、和环境许多塑料封装吸潮,造成裝配处理期间的破裂 物理因素也包括安装工艺的复杂性与最终产品的可靠性。进一步的财政决定必须考虑产品将 如何制造和装配设备效率。较脆弱的引脚元件,如0.50与0.40mm0.020 与0.016”引脚间距的 SQFP shrink gu a d fl a t pa ck,可 能在维护一个持续的装配工艺合格率方面向装配专家提出一个挑战。最成功的开发计划是那 些已经实行工艺认证的电路板设计指引和工艺认证的焊盘几何形状 在环境上,焊盘几何形状可能不同,它基于所用的安装电子零件的焊接类型。可能的时 候,焊盘形状应该以一种对使用的安装工艺透明的方式来定义。不管零件是安装在板的一面 或两面、经受波峰、回流或其它焊接,焊盘与零件尺寸应该优化,以保证适当的焊接点与检 查标准。虽然焊盘图案是在尺寸上定义的,并且因为它是印制板电路几何形状的一部分,它 们受到可生产性水平和与电镀、腐蚀、装配或其它条件有关的公差的限制。生产性方面也与 阻焊层的使用和在阻焊与导体图案之间的对齐定位有关。 1、焊盘的要求 国际电子技术委员会 I EC Interna tionaleletrotec h n i c al commi ssion的61188标准认识到对焊接圆角或焊盘凸起条 件的不同目标的需要。这个新的国际标准确认两个为开发焊盘形状提供信息的基本方法: 1).基于工业元件规格、电路板制造和元件贴装精度能力的准确资料。这些焊盘形状 局限于一个特定的元件,有一个标识焊盘形状的编号 2).一些方程式可用来改变给定的信息,以达到一个更稳健的焊接连接,这是用于 些特殊的情况,在这些情况中用于贴装或安装设备比在决定焊盘细节时所假设的精度有或多 或少的差别。 该标准为用于贴装各种引脚或元件端子的焊盘定义了最大、中等和最小材料情况。除非 另外标明,这个标准将所有三中“希望目标”标记为一级、二级或三级 一级:最大一用于低密度产品应用,“最大”焊盘条件用于波峰或流动焊接无引脚的片 状元件和有引脚的翅形元件。为这些元件以及向内的”J”型引脚元件配置的几何形状可以为

高速 PCB 设计指南 - 1 - 高速 PCB 设计指南之二 第一篇 高密度(HD)电路的设计 本文介绍，许多人把芯片规模的ＢＧＡ封装看作是由便携式电子产品所需的空间限制的 一个可行的解决方案，它同时满足这些产品更高功能与性能的要求。为便携式产品的高密度 电路设计应该为装配工艺着想。 当为今天价值推动的市场开发电子产品时，性能与可靠性是最优先考虑的。为了在这个 市场上竞争，开发者还必须注重装配的效率，因为这样可以控制制造成本。电子产品的技术 进步和不断增长的复杂性正产生对更高密度电路制造方法的需求。当设计要求表面贴装、密 间距和向量封装的集成电路 ＩＣ 时，可能要求具有较细的线宽和较密间隔的更高密度电 路板。可是，展望未来，一些已经在供应微型旁路孔、序列组装电路板的公司正大量投资来 扩大能力。这些公司认识到便携式电子产品对更小封装的目前趋势。单是通信与个人计算产 品工业就足以领导全球的市场。 高密度电子产品的开发者越来越受到几个因素的挑战：物理 复杂元件上更密的引脚间 隔 、财力 贴装必须很精密 、和环境 许多塑料封装吸潮，造成装配处理期间的破裂 。 物理因素也包括安装工艺的复杂性与最终产品的可靠性。进一步的财政决定必须考虑产品将 如何制造和装配设备效率。较脆弱的引脚元件，如０．５０与０．４０ｍｍ ０．０２０″ 与０．０１６″ 引脚间距的ＳＱＦＰ ｓｈｒｉｎｋ ｑｕａｄ ｆｌａｔ ｐａｃｋ ，可 能在维护一个持续的装配工艺合格率方面向装配专家提出一个挑战。最成功的开发计划是那 些已经实行工艺认证的电路板设计指引和工艺认证的焊盘几何形状。 在环境上，焊盘几何形状可能不同，它基于所用的安装电子零件的焊接类型。可能的时 候，焊盘形状应该以一种对使用的安装工艺透明的方式来定义。不管零件是安装在板的一面 或两面、经受波峰、回流或其它焊接，焊盘与零件尺寸应该优化，以保证适当的焊接点与检 查标准。虽然焊盘图案是在尺寸上定义的，并且因为它是印制板电路几何形状的一部分，它 们受到可生产性水平和与电镀、腐蚀、装配或其它条件有关的公差的限制。生产性方面也与 阻焊层的使用和在阻焊与导体图案之间的对齐定位有关。 1、焊盘的要求 国际电子技术委员会 ＩＥＣ Ｉｎｔｅｒｎａｔｉｏｎａｌ Ｅｌｅｔｒｏｔｅｃ ｈｎｉｃａｌ Ｃｏｍｍｉｓｓｉｏｎ 的６１１８８标准认识到对焊接圆角或焊盘凸起条 件的不同目标的需要。这个新的国际标准确认两个为开发焊盘形状提供信息的基本方法： １)．基于工业元件规格、电路板制造和元件贴装精度能力的准确资料。这些焊盘形状 局限于一个特定的元件，有一个标识焊盘形状的编号。 ２)．一些方程式可用来改变给定的信息，以达到一个更稳健的焊接连接，这是用于一 些特殊的情况，在这些情况中用于贴装或安装设备比在决定焊盘细节时所假设的精度有或多 或少的差别。 该标准为用于贴装各种引脚或元件端子的焊盘定义了最大、中等和最小材料情况。除非 另外标明，这个标准将所有三中“希望目标”标记为一级、二级或三级。 一级：最大 － 用于低密度产品应用，“最大”焊盘条件用于波峰或流动焊接无引脚的片 状元件和有引脚的翅形元件。为这些元件以及向内的″Ｊ″型引脚元件配置的几何形状可以为

高速PCB设计指南 手工焊接和回流焊接提供一个较宽的工艺窗口。 二级:中等一具有中等水平元件密度的产品可以考虑采用这个“中等”的焊盘几何形 状。与IPC一SM一782标准焊盘几何形状非常相似,为所有元件类型配置的中等焊盘 将为回流焊接工艺提供一个稳健的焊接条件,并且应该为无引脚元件和翅形引脚类元件的波 峰或流动焊接提供适当的条件 三级:最小一具有高元件密度的产品通常是便携式产品应用可以考虑“最小”焊盘 几何形状。最小焊盘几何形状的选择可能不适合于所有的产品。在采用最小的焊盘形状之前, 使用这应该考虑产品的限制条件,基于表格中所示的条件进行试验 在IPC一SM-782中所提供的以及在IEC61188中所配置的焊盘几何形 状应该接纳元件公差和工艺变量。虽然在IPC标准中的焊盘已经为使用者的多数装配应用 提供一个稳健的界面,但是一些公司已经表示了对采用最小焊盘几何形状的需要,以用于便 携式电子产品和其它独特的高密度应用。 国际焊盘标准(IEC61188)了解到更高零件密度应用的要求,并提供用于特殊产 品类型的焊盘几何形状的信息。这些信息的目的是要提供适当的表面贴装焊盘的尺寸、形状 和公差,以保证适当焊接圆角的足够区域,也允许对这些焊接点的检查、测试和返工 图一和表一所描述的典型的三类焊盘几何形状是为每一类元件所提供的:最大焊盘( 级)、中等焊盘(二级)和最小焊盘(三级)。 图一、两个端子的、矩形电容与电阻元件的IEC标准可以不同以满足特殊产品应用 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出0.60.40.2 脚跟-焊盘突出0.00.00.0 侧面-焊盘突出0.10.00.0 开井余量0.50.250.05 圆整因素最近0.5最近0.05最近0.05 表一、矩形与方形端的元件 (陶瓷电容与电阻)(单位mm) 焊接点的脚趾、脚跟和侧面圆角必须针对元件、电路板和贴装精度偏差的公差平方和 如图二所示,最小的焊接点或焊盘突出是随着公差变量而增加的(表二)。 图二、带状翅形引脚元件的IEC标准定义了三种可能的变量以满足用户的应用 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出0.80.50.2 脚跟-焊盘突出0.50.350.2 侧面-焊盘突出0.050.050.03 开井余量0.50.250.05 圆整因素最近0.5最近0.05最近0.05 表二、平带L形与翅形引脚 (大于0625mm的间距)(单位mm)

高速 PCB 设计指南 - 2 - 手工焊接和回流焊接提供一个较宽的工艺窗口。 二级：中等 － 具有中等水平元件密度的产品可以考虑采用这个“中等”的焊盘几何形 状。与ＩＰＣ－ＳＭ－７８２标准焊盘几何形状非常相似，为所有元件类型配置的中等焊盘 将为回流焊接工艺提供一个稳健的焊接条件，并且应该为无引脚元件和翅形引脚类元件的波 峰或流动焊接提供适当的条件。 三级：最小 － 具有高元件密度的产品 通常是便携式产品应用 可以考虑“最小”焊盘 几何形状。最小焊盘几何形状的选择可能不适合于所有的产品。在采用最小的焊盘形状之前， 使用这应该考虑产品的限制条件，基于表格中所示的条件进行试验。 在ＩＰＣ－ＳＭ－７８２中所提供的以及在ＩＥＣ６１１８８中所配置的焊盘几何形 状应该接纳元件公差和工艺变量。虽然在ＩＰＣ标准中的焊盘已经为使用者的多数装配应用 提供一个稳健的界面，但是一些公司已经表示了对采用最小焊盘几何形状的需要，以用于便 携式电子产品和其它独特的高密度应用。 国际焊盘标准(ＩＥＣ６１１８８)了解到更高零件密度应用的要求，并提供用于特殊产 品类型的焊盘几何形状的信息。这些信息的目的是要提供适当的表面贴装焊盘的尺寸、形状 和公差，以保证适当焊接圆角的足够区域，也允许对这些焊接点的检查、测试和返工。 图一和表一所描述的典型的三类焊盘几何形状是为每一类元件所提供的：最大焊盘(一 级)、中等焊盘(二级)和最小焊盘(三级)。 图一、两个端子的、矩形电容与电阻元件的 IEC 标准可以不同以满足特殊产品应用 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 0.6 0.4 0.2 脚跟-焊盘突出 0.0 0.0 0.0 侧面-焊盘突出 0.1 0.0 0.0 开井余量 0.5 0.25 0.05 圆整因素 最近 0.5 最近 0.05 最近 0.05 表一、矩形与方形端的元件 (陶瓷电容与电阻) (单位:mm) 焊接点的脚趾、脚跟和侧面圆角必须针对元件、电路板和贴装精度偏差的公差 平方和 。如图二所示，最小的焊接点或焊盘突出是随着公差变量而增加的（表二）。 图二、带状翅形引脚元件的 IEC 标准定义了三种可能的变量以满足用户的应用 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 0.8 0.5 0.2 脚跟-焊盘突出 0.5 0.35 0.2 侧面-焊盘突出 0.05 0.05 0.03 开井余量 0.5 0.25 0.05 圆整因素 最近 0.5 最近 0.05 最近 0.05 表二、平带 L 形与翅形引脚 (大于 0.625mm 的间距) (单位:mm)

高速PCB设计指南 如果这些焊盘的用户希望对贴装和焊接设备有一个更稳健的工艺条件,那么分析中的个 别元素可以改变到新的所希望的尺寸条件。这包括元件、板或贴装精度的扩散,以及最小的 焊接点或焊盘突出的期望(表3,4,5和6)。 用于焊盘的轮廓公差方法的方式与元件的类似。所有焊盘公差都是要对每一个焊盘以最 大尺寸提供一个预计的焊盘图形。单向公差是要减小焊盘尺寸,因此得当焊接点形成的较小 区域。为了使开孔的尺寸标注系统容易,焊盘是跨过内外极限标注尺寸的 在这个标准中,尺寸标注概念使用极限尺寸和几何公差来描述焊盘允许的最大与最小尺 寸。当焊盘在其最大尺寸时,结果可能是最小可接受的焊盘之间的间隔;相反,当焊盘在其 最小尺寸时,结果可能是最小的可接受焊盘,需要达到可靠的焊接点。这些极限允许判断焊 盘通过/不通过的条件。 假设焊盘几何形状是正确的,并且电路结构的最终都满足所有规定标准,焊接缺陷应该 可以减少:尽管如此,焊接缺陷还可能由于材料与工艺变量而发生。为密间距 f i n e p tch开发焊盘的设计者必须建立一个可靠的焊接连接所要求的最小脚尖与脚跟,以及 在元件封装特征上允许最大与最小或至少的材料条件。 表三、J形引脚(单位mm) 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出0.20.20.2 脚跟-焊盘突出0.80.60.4 侧面-焊盘突出0.10.0500 开井余量1.50.80.2 圆整因素最近0.5最近0.05最近0.05 表四、圆柱形端子(MELF)(单位mm) 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出1.00.40.2 脚跟-焊盘突出0.20.10.0 侧面-焊盘突出0.20.10.0 开井余量0.20.25025 圆整因素最近0.5最近0.05最近0.05 表五、只有底面的端子(单位mm) 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出0.20.10 脚跟-焊盘突出0.20.10 侧面-焊盘突出0.20.10 开井余量0.250.10.05 圆整因素最近0.5最近0.05最近0.05 表六、内向L形带状引脚(单位mm)

高速 PCB 设计指南 - 3 - 如果这些焊盘的用户希望对贴装和焊接设备有一个更稳健的工艺条件，那么分析中的个 别元素可以改变到新的所希望的尺寸条件。这包括元件、板或贴装精度的扩散，以及最小的 焊接点或焊盘突出的期望（表３，４，５和６）。 用于焊盘的轮廓公差方法的方式与元件的类似。所有焊盘公差都是要对每一个焊盘以最 大尺寸提供一个预计的焊盘图形。单向公差是要减小焊盘尺寸，因此得当焊接点形成的较小 区域。为了使开孔的尺寸标注系统容易，焊盘是跨过内外极限标注尺寸的。 在这个标准中，尺寸标注概念使用极限尺寸和几何公差来描述焊盘允许的最大与最小尺 寸。当焊盘在其最大尺寸时，结果可能是最小可接受的焊盘之间的间隔；相反，当焊盘在其 最小尺寸时，结果可能是最小的可接受焊盘，需要达到可靠的焊接点。这些极限允许判断焊 盘通过／不通过的条件。 假设焊盘几何形状是正确的，并且电路结构的最终都满足所有规定标准，焊接缺陷应该 可以减少；尽管如此，焊接缺陷还可能由于材料与工艺变量而发生。为密间距 ｆｉｎｅ ｐ ｉｔｃｈ 开发焊盘的设计者必须建立一个可靠的焊接连接所要求的最小脚尖与脚跟，以及 在元件封装特征上允许最大与最小 或至少 的材料条件。 表三、J 形引脚 (单位:mm) 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 0.2 0.2 0.2 脚跟-焊盘突出 0.8 0.6 0.4 侧面-焊盘突出 0.1 0.05 0.0 开井余量 1.5 0.8 0.2 圆整因素 最近 0.5 最近 0.05 最近 0.05 表四、圆柱形端子（MELF） (单位:mm) 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 1.0 0.4 0.2 脚跟-焊盘突出 0.2 0.1 0.0 侧面-焊盘突出 0.2 0.1 0.0 开井余量 0.2 0.25 0.25 圆整因素 最近 0.5 最近 0.05 最近 0.05 表五、只有底面的端子 (单位:mm) 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 0.2 0.1 0 脚跟-焊盘突出 0.2 0.1 0 侧面-焊盘突出 0.2 0.1 0 开井余量 0.25 0.1 0.05 圆整因素 最近 0.5 最近 0.05 最近 0.05 表六、内向 L 形带状引脚 (单位:mm)

高速PCB设计指南 焊盘特性最大一级中等二级最小三级 脚趾-焊盘突出0.10.10.0 脚跟-焊盘突出1.00.50.2 侧面-焊盘突出0.10.10.1 开井余量0.50.25005 圆整因素最近0.5最近0.05最近0.05 2、BGA与CAP BGA封装已经发展到满足现在的焊接安装技术。塑料与陶瓷BGA元件具有相对广泛 的接触间距(1.50,1.27和1.00mm),而相对而言,芯片规模的BGA栅格 间距为0.50,0.60和0.80mm。BGA与密间距BGA元件两者相对于密间距 引脚框架封装的ⅠC都不容易损坏,并且BGA标准允许选择性地减少接触点,以满足特殊 的输入/输出(I/O)要求。当为BGA元件建立接触点布局和引线排列时,封装开发者 必须考虑芯片设计以及芯片块的尺寸和形状。在技术引线排列时的另一个要面对的问题是芯 片的方向芯片模块的焊盘向上或向下。芯片模块“面朝上”的结构通常是当供应商正在使 用COB(chip-on- bo ar d)(内插器)技术时才采用的 元件构造,以及在其制造中使用的材料结合,不在这个工业标准与指引中定义。每 个制造商都将企图将其特殊的结构胜任用户所定义的应用。例如消费产品可能有一个相对 良好的工作环境,而工业或汽车应用的产品经常必须运行在更大的压力条件下。取决于制造 BGA所选择材料的物理特性,可能要使用到倒装芯片或引线接合技术。因为芯片安装结构 是刚性材料,芯片模块安装座一般以导体定中心,信号从芯片模块焊盘走入接触球的排列矩 在该文件中详细叙述的栅格阵列封装外形在 JEDEC的95出版物中提供。方形B GA, J EDEC MS-028定义一种较小的矩形塑料BGA元件类别,接触点间隔为 1.27mm。该矩阵元件的总的外形规格允许很大的灵活性,如引脚间隔、接触点矩阵布 局与构造。 J EDEC MO-151定义各种塑料封装的BGA。方形轮廓覆盖的尺寸从 7.0-50.0,三种接触点间隔-1.50 27和1.00mm。 球接触点可以单一的形式分布,行与列排列有双数或单数。虽然排列必须保持对整个 封装外形的对称,但是各元件制造商允许在某区域内减少接触点的位置 3、芯片规模的BGA变量 针对“密间距”和“真正芯片大小”的IC封装,最近开发的 JEDEC BGA指引提出 许多物理属性,并为封装供应商提供“变量”形式的灵活性。 JEdec J O-11批准的 第一份对密间距元件类别的文件是注册外形MO一195,具有基本0.50mm间距接触 点排列的统一方形封装系列 封装尺寸范围从4 21.0mm,总的高度(定义为“薄的轮廓)限制到从贴装 表面最大为1.20mma下面的例子代表为将来的标准考虑的一些其它变量 球间距与球尺寸将也会影响电路布线效率。许多公司已经选择对较低I/O数的CS P不采用0.50mm间距。较大的球间距可能减轻最终用户对更复杂的印刷电路板(PC B)技术的需求 0.50mm的接触点排列间隔是 JEDEC推荐最小的。接触点直径规定为0.3 0mm,公差范围为最小0.25、最大0.35mm。可是大多数采用0.50mm间距

高速 PCB 设计指南 - 4 - 焊盘特性 最大一级 中等二级 最小三级 脚趾-焊盘突出 0.1 0.1 0.0 脚跟-焊盘突出 1.0 0.5 0.2 侧面-焊盘突出 0.1 0.1 0.1 开井余量 0.5 0.25 0.05 圆整因素 最近 0.5 最近 0.05 最近 0.05 2、BGA 与 CAP ＢＧＡ封装已经发展到满足现在的焊接安装技术。塑料与陶瓷ＢＧＡ元件具有相对广泛 的接触间距（１．５０，１．２７和１．００ｍｍ），而相对而言，芯片规模的ＢＧＡ栅格 间距为０．５０，０．６０和０．８０ｍｍ。ＢＧＡ与密间距ＢＧＡ元件两者相对于密间距 引脚框架封装的ＩＣ都不容易损坏，并且ＢＧＡ标准允许选择性地减少接触点，以满足特殊 的输入／输出（Ｉ／Ｏ）要求。当为ＢＧＡ元件建立接触点布局和引线排列时，封装开发者 必须考虑芯片设计以及芯片块的尺寸和形状。在技术引线排列时的另一个要面对的问题是芯 片的方向 芯片模块的焊盘向上或向下 。芯片模块“面朝上”的结构通常是当供应商正在使 用ＣＯＢ（ｃｈｉｐ－ｏｎ－ｂｏａｒｄ）（内插器）技术时才采用的。 元件构造，以及在其制造中使用的材料结合，不在这个工业标准与指引中定义。每一 个制造商都将企图将其特殊的结构胜任用户所定义的应用。例如 消费产品可能有一个相对 良好的工作环境，而工业或汽车应用的产品经常必须运行在更大的压力条件下。取决于制造 ＢＧＡ所选择材料的物理特性，可能要使用到倒装芯片或引线接合技术。因为芯片安装结构 是刚性材料，芯片模块安装座一般以导体定中心，信号从芯片模块焊盘走入接触球的排列矩 阵。 在该文件中详细叙述的栅格阵列封装外形在ＪＥＤＥＣ的９５出版物中提供。方形Ｂ ＧＡ，ＪＥＤＥＣ ＭＳ－０２８定义一种较小的矩形塑料ＢＧＡ元件类别，接触点间隔为 １．２７ｍｍ。该矩阵元件的总的外形规格允许很大的灵活性，如引脚间隔、接触点矩阵布 局与构造。ＪＥＤＥＣ ＭＯ－１５１定义各种塑料封装的ＢＧＡ。方形轮廓覆盖的尺寸从 ７．０－５０．０，三种接触点间隔 － １．５０，１．２７和１．００ｍｍ。 球接触点可以单一的形式分布，行与列排列有双数或单数。虽然排列必须保持对整个 封装外形的对称，但是各元件制造商允许在某区域内减少接触点的位置。 3、芯片规模的 BGA 变量 针对“密间距”和“真正芯片大小”的ＩＣ封装，最近开发的ＪＥＤＥＣ ＢＧＡ指引提出 许多物理属性，并为封装供应商提供“变量”形式的灵活性。ＪＥＤＥＣ ＪＣ－１１批准的 第一份对密间距元件类别的文件是注册外形ＭＯ－１９５，具有基本０．５０ｍｍ间距接触 点排列的统一方形封装系列。 封装尺寸范围从４．０－２１．０ｍｍ，总的高度(定义为“薄的轮廓”)限制到从贴装 表面最大为１．２０ｍｍ。下面的例子代表为将来的标准考虑的一些其它变量。 球间距与球尺寸将也会影响电路布线效率。许多公司已经选择对较低Ｉ／Ｏ数的ＣＳ Ｐ不采用０．５０ｍｍ间距。较大的球间距可能减轻最终用户对更复杂的印刷电路板(ＰＣ Ｂ)技术的需求。 ０．５０ｍｍ的接触点排列间隔是ＪＥＤＥＣ推荐最小的。接触点直径规定为０．３ ０ｍｍ，公差范围为最小０．２５、最大０．３５ｍｍ。可是大多数采用０．５０ｍｍ间距

高速PCB设计指南 的BGA应用将依靠电路的次表面布线。直径上小至0.25mm的焊盘之间的间隔宽度只 够连接一根0.08mm(0.003")宽度的电路。将许多多余的电源和接地触点分布 到矩阵的周围,这样将提供对排列矩阵的有限渗透。这些较高I/O数的应用更可能决定于 多层、盲孔或封闭的焊盘上的电镀旁路孔(via-on-pad)技术 4、考虑封装技术 元件的环境与电气性能可能是与封装尺寸一样重要的问题。用于高密度、高I/O应用 的封装技术首先必须满足环境标准。例如,那些使用刚性内插器( I n terser)结 构的、由陶瓷或有机基板制造的不能紧密地配合硅芯片的外形。元件四周的引线接合座之间 的互连必须流向内面。μBGA*封装结构的一个实际优势是它在硅芯片模块外形内提供所 有电气界面的能力。 μBGA使用一种高级的聚酰胺薄膜作为其基体结构,并且使用半加成铜电镀工艺来完 成芯片上铝接合座与聚酰胺内插器上球接触座之间的互连。依顺材料的独特结合使元件能够 忍受极端恶劣的环境。这种封装已经由一些主要的IC制造商用来满足具有广泛运作环境的 应用 超过20家主要的IC制造商和封装服务提供商已经采用了μBGA封装。定义为面 朝下”的封装,元件外形密切配合芯片模块的外形,芯片上的铝接合焊盘放于朝向球接触点 和PCB表面的位置。这种结构在工业中有最广泛的认同,因为其建立的基础结构和无比的 可靠性。μBGA封装的材料与引脚设计的独特系统是在物理上顺应的,补偿了硅芯片与P CB结构的温度膨胀系统的较大差别 5、安装座计划 推荐给BGA元件的安装座或焊盘的几何形状通常是圆形的,可以调节直径来满足接触 点间隔和尺寸的变化。焊盘直径应该不大于封装上接触点或球的直径,经常比球接触点规定 的正常直径小10%。在最后确定焊盘排列与几何形状之前,参考ⅠPC-SM一782第 14.0节或制造商的规格 有两种方法用来定义安装座:定义焊盘或铜,定义阻焊,如图三所示。 图三、BGA的焊盘可以通过化学腐蚀的图案来界定 无阻焊层或有阻焊层叠加在焊盘圆周上(阻焊层界定) 铜定义焊盘图形—通过腐蚀的铜界定焊盘图形。阻焊间隔应该最小离腐蚀的铜焊盘 0.075mm。对要求间隔小于所推荐值的应用,咨询印制板供应商。 阻焊定义焊盘图形一如果使用阻焊界定的图形,相应地调整焊盘直径,以保证阻焊的 覆盖 BGA元件上的焊盘间隔活间距是“基本的”,因此是不累积的:可是,贴装精度和PC B制造公差必须考虑。如前面所说的,BGA的焊盘一般是圆形的、阻焊界定或腐蚀阻焊 脱离焊盘界定的。虽然较大间距的BGA将接纳电路走线的焊盘之间的间隔,较高I/O 的元件将依靠电镀旁路孔来将电路走到次表面层。表七所示的焊盘几何形状推荐一个与名义 标准接触点或球的直径相等或稍小的直径 表七、BGA元件安装的焊盘图形 接触点间距

高速 PCB 设计指南 - 5 - 的ＢＧＡ应用将依靠电路的次表面布线。直径上小至０．２５ｍｍ的焊盘之间的间隔宽度只 够连接一根０．０８ｍｍ（０．００３″）宽度的电路。将许多多余的电源和接地触点分布 到矩阵的周围，这样将提供对排列矩阵的有限渗透。这些较高Ｉ／Ｏ数的应用更可能决定于 多层、盲孔或封闭的焊盘上的电镀旁路孔(ｖｉａ－ｏｎ－ｐａｄ)技术。 4、考虑封装技术 元件的环境与电气性能可能是与封装尺寸一样重要的问题。用于高密度、高Ｉ／Ｏ应用 的封装技术首先必须满足环境标准。例如，那些使用刚性内插器(ｉｎｔｅｒｐｏｓｅｒ)结 构的、由陶瓷或有机基板制造的不能紧密地配合硅芯片的外形。元件四周的引线接合座之间 的互连必须流向内面。μＢＧＡ* 封装结构的一个实际优势是它在硅芯片模块外形内提供所 有电气界面的能力。 μＢＧＡ使用一种高级的聚酰胺薄膜作为其基体结构，并且使用半加成铜电镀工艺来完 成芯片上铝接合座与聚酰胺内插器上球接触座之间的互连。依顺材料的独特结合使元件能够 忍受极端恶劣的环境。这种封装已经由一些主要的ＩＣ制造商用来满足具有广泛运作环境的 应用。 超过２０家主要的ＩＣ制造商和封装服务提供商已经采用了 μＢＧＡ封装。定义为“面 朝下”的封装，元件外形密切配合芯片模块的外形，芯片上的铝接合焊盘放于朝向球接触点 和ＰＣＢ表面的位置。这种结构在工业中有最广泛的认同，因为其建立的基础结构和无比的 可靠性。μＢＧＡ封装的材料与引脚设计的独特系统是在物理上顺应的，补偿了硅芯片与Ｐ ＣＢ结构的温度膨胀系统的较大差别。 5、安装座计划 推荐给ＢＧＡ元件的安装座或焊盘的几何形状通常是圆形的，可以调节直径来满足接触 点间隔和尺寸的变化。焊盘直径应该不大于封装上接触点或球的直径，经常比球接触点规定 的正常直径小１０％。在最后确定焊盘排列与几何形状之前，参考ＩＰＣ－ＳＭ－７８２第 １４．０节或制造商的规格。 有两种方法用来定义安装座：定义焊盘或铜，定义阻焊，如图三所示。 图三、ＢＧＡ的焊盘可以通过化学腐蚀的图案来界定， 无阻焊层或有阻焊层叠加在焊盘圆周上（阻焊层界定） 铜定义焊盘图形 － 通过腐蚀的铜界定焊盘图形。阻焊间隔应该最小离腐蚀的铜焊盘 ０．０７５ｍｍ。对要求间隔小于所推荐值的应用，咨询印制板供应商。 阻焊定义焊盘图形 － 如果使用阻焊界定的图形，相应地调整焊盘直径，以保证阻焊的 覆盖。 ＢＧＡ元件上的焊盘间隔活间距是“基本的”，因此是不累积的；可是，贴装精度和ＰＣ Ｂ制造公差必须考虑。如前面所说的，ＢＧＡ的焊盘一般是圆形的、阻焊界定或腐蚀 阻焊 脱离焊盘 界定的。虽然较大间距的ＢＧＡ将接纳电路走线的焊盘之间的间隔，较高Ｉ／Ｏ 的元件将依靠电镀旁路孔来将电路走到次表面层。表七所示的焊盘几何形状推荐一个与名义 标准接触点或球的直径相等或稍小的直径。 表七、 BGA 元件安装的焊盘图形 接触点间距

高速PCB设计指南 (基本的)标准球直径焊盘直径(mm) 最小名义最大最小·最大 0.050.250.300.350.250.30 0.650.250.300.350.250.30 0.650.350.400450.35-0.40 0.800.250.300.350.25-0.30 0.800.350.400.450.35-0.40 0.800450.500.550.40-0.50 1.000.550.600.650.50-0.6 1.270.700.750.800.60-0.70 1500.700.750.800.60-0.70 有些公司企图为所有密间距的BGA应用维持一个不变的接触点直径。可是,因为一些 0.65与0.80mm接触点间距的元件制造商允许随意的球与接触点直径的变化,设计 者应该在制定焊盘直径之前参考专门的供应商规格。较大的球与焊盘的直径可能限制较高I /O元件的电路布线。一些BGA元件类型的焊盘几何形状可能不允许宽度足够容纳不止 条或两条电路的间隔。例如,0.50mm间距的BGA将不允许甚至一条大于0.002 或0.003"的电路。那些采用密间距BGA封装变量的可能发现焊盘中的旁路孔(微型旁 路孔)更加实际,特别如果元件密度高,必须减少电路布线 6、装配工艺效率所要求的特征 为了采纳对密间距表面贴装元件(SMD)的模板的精确定位,要求一些视觉或摄像机帮 助的对中方法。全局定位基准点是用于准确的锡膏印刷的模板定位和在精确的SMD贴装中 作为参考点。模板印刷机的摄相机系统自动将板对准模板,达到准确的锡膏转移。 对于那些使用模板到电路板的自动视觉对中的系统,电路板的设计者必须在焊盘层的设 计文件中提供至少两个全局基准点(图四)。在组合板的每一个装配单元内也必须提供局部 基准点目标,以帮助自动元件贴装。另外,对于每一个密间距QFP、TSOP和高I/O 密间距BGA元件,通常提供一或两个目标。 在所有位置推荐使用一个基准点的尺寸。虽然形状和尺寸可以对不同的应用分别对待,但是 大多数设备制造商都认同1.0mm(0.040")直径的实心点。该点必须没有阻焊层, 以保证摄相机可以快速识别。除了基准点目标外,电路板必须包含一些定位孔,用于二次装 配有关的操作。组合板应该提供两或三个定位孔,每个电路板报单元提供至少两个定位孔 通常,装配专家规定尺寸(0.65mm是常见的),应该指定无电镀孔 至于在锡膏印刷模板夹具上提供的基准点,一些系统检测模板的定面,而另一些则检测 底面。模板上的全局基准点只是半腐蚀在模板的表面,用黑树脂颜料填充 7、指定表面最终涂层 为元件的安装选择专门类型的表面最终涂镀方法可以提高装配工艺的效率,但是也可能 影响PCB的制造成本。在铜箔上电镀锡或锡/铅合金作为抗腐蚀层是非常常见的制造方 法。选择性地去掉铜箔的减去法化学腐蚀继续在PCB工业广泛使用。因为锡/铅导线 当暴露在195°C温度以上时变成液体,所以大多数使用回流焊接技术的表面贴装板都指 定裸铜上的阻焊层( SMOBC, soldermask over bare copper) 来保持阻焊材料下一个平坦均匀的表面。当处理 SMOBC板时,锡或锡/铅是化学剥离的, 只留下铜导体和没有电镀的元件安装座。铜导体用环氧树脂或聚合物阻焊层涂盖,以防止对

高速 PCB 设计指南 - 6 - （基本的） 标准球直径 焊盘直径 (mm) 最小 名义 最大 最小 - 最大 0.05 0.25 0.30 0.35 0.25-0.30 0.65 0.25 0.30 0.35 0.25-0.30 0.65 0.35 0.40 0.45 0.35-0.40 0.80 0.25 0.30 0.35 0.25-0.30 0.80 0.35 0.40 0.45 0.35-0.40 0.80 0.45 0.50 0.55 0.40-0.50 1.00 0.55 0.60 0.65 0.50-0.60 1.27 0.70 0.75 0.80 0.60-0.70 1.50 0.70 0.75 0.80 0.60-0.70 有些公司企图为所有密间距的ＢＧＡ应用维持一个不变的接触点直径。可是，因为一些 ０．６５与０．８０ｍｍ接触点间距的元件制造商允许随意的球与接触点直径的变化，设计 者应该在制定焊盘直径之前参考专门的供应商规格。较大的球与焊盘的直径可能限制较高Ｉ ／Ｏ元件的电路布线。一些ＢＧＡ元件类型的焊盘几何形状可能不允许宽度足够容纳不止一 条或两条电路的间隔。例如，０．５０ｍｍ间距的ＢＧＡ将不允许甚至一条大于０．００２″ 或０．００３″的电路。那些采用密间距ＢＧＡ封装变量的可能发现焊盘中的旁路孔(微型旁 路孔)更加实际，特别如果元件密度高，必须减少电路布线。 6、装配工艺效率所要求的特征 为了采纳对密间距表面贴装元件(ＳＭＤ)的模板的精确定位，要求一些视觉或摄像机帮 助的对中方法。全局定位基准点是用于准确的锡膏印刷的模板定位和在精确的ＳＭＤ贴装中 作为参考点。模板印刷机的摄相机系统自动将板对准模板，达到准确的锡膏转移。 对于那些使用模板到电路板的自动视觉对中的系统，电路板的设计者必须在焊盘层的设 计文件中提供至少两个全局基准点（图四）。在组合板的每一个装配单元内也必须提供局部 基准点目标，以帮助自动元件贴装。另外，对于每一个密间距ＱＦＰ、ＴＳＯＰ和高Ｉ／Ｏ 密间距ＢＧＡ元件，通常提供一或两个目标。 在所有位置推荐使用一个基准点的尺寸。虽然形状和尺寸可以对不同的应用分别对待，但是 大多数设备制造商都认同１．０ｍｍ（０．０４０″）直径的实心点。该点必须没有阻焊层， 以保证摄相机可以快速识别。除了基准点目标外，电路板必须包含一些定位孔，用于二次装 配有关的操作。组合板应该提供两或三个定位孔，每个电路板报单元提供至少两个定位孔。 通常，装配专家规定尺寸（０．６５ｍｍ是常见的），应该指定无电镀孔。 至于在锡膏印刷模板夹具上提供的基准点，一些系统检测模板的定面，而另一些则检测 底面。模板上的全局基准点只是半腐蚀在模板的表面，用黑树脂颜料填充。 7、指定表面最终涂层 为元件的安装选择专门类型的表面最终涂镀方法可以提高装配工艺的效率，但是也可能 影响ＰＣＢ的制造成本。在铜箔上电镀锡或锡／铅合金作为抗腐蚀层是非常常见的制造方 法。选择性地去掉铜箔的减去法 化学腐蚀 继续在ＰＣＢ工业广泛使用。因为锡／铅导线 当暴露在１９５°Ｃ温度以上时变成液体，所以大多数使用回流焊接技术的表面贴装板都指 定裸铜上的阻焊层(ＳＭＯＢＣ,ｓｏｌｄｅｒｍａｓｋ ｏｖｅｒ ｂａｒｅ ｃｏｐｐｅｒ) 来保持阻焊材料下一个平坦均匀的表面。当处理ＳＭＯＢＣ板时，锡或锡／铅是化学剥离的， 只留下铜导体和没有电镀的元件安装座。铜导体用环氧树脂或聚合物阻焊层涂盖，以防止对

高速PCB设计指南 焊接有关工艺的暴露。虽然电路导线有阻焊层覆盖,设计者还必须为那些不被阻焊层覆盖的 部分元件安装座指定表面涂层。下面的例子是广泛使用在制造工业的合金电镀典型方 法 通常要求预处理安装座的应用是超密间距QFP元件。例如,TAB( t oma t ed bon d)元件可能具有小于0.25mm的引脚间距。通过在这些座上提 供700—800μ"的锡/铅合金,装配专家可以上少量的助焊剂、贴装零件和使用加热棒 热风、激光或软束线光源来回流焊接该元件。在特殊的安装座上选择性地电镀或保留锡/铅 合金将适用于超密间距TAB封装的回流焊接。 使用热风均匀法,锡/铅在上阻焊层之后涂镀在电路板上。该工艺是,电镀的板经过清 洗、上助焊剂和浸入熔化的焊锡中,当合金还是液体状态的时候,多余的材料被吹离表面, 留下合金覆盖的表面。热风焊锡均匀HASL( hot ai rsoldereve ng)电镀工艺广泛使用,一般适合于回流焊接装配工艺;可是,焊锡量与平整度的不 致可能不适合于使用密间距元件的电路板 密间距的SQFP、TSOP和BGA元件要求非常均匀和平整的表面涂层。作为控制 在密间距元件的安装座上均匀锡膏量的方法,表面必须尽可能地平整。为了保证平整度,许 多公司在铜箔上使用镍合金,接着一层很薄的金合金涂层,来去掉氧化物 在阻焊凃层工艺之后,在暴露的裸铜上使用无电镀镍/金。用这个工艺,制造商通常将 使用锡/铅电镀图案作为抗腐蚀层,在腐蚀之后剥离锡/铅合金,但是不是对暴露的安装座 和孔施用焊锡合金,而是电路板浸镀镍/金合金。 按照IPC一2221标准《印制板设计的通用标准》,推荐的无电镀镍厚度是2.5 5.0gm(至少1.3μm),而推荐的浸金厚度为0.08-0.23gm 有关金的合金与焊接工艺的一句话忠告:如果金涂层厚度超过0.8μm(3μ"),那么 金对锡/铅比率可能引起最终焊接点的脆弱。脆弱将造成温度循环中的过分开裂或装配后的 板可能暴露到的其它物理应力 8、合金电镀替代方案 在上阻焊层之后给板増加焊锡合金是有成本代价的,并且给基板遭受极大的应力条件 例如用锡/铅涂层,板插入熔化的焊锡中,然后抽岀和用强风将多余的锡/铅材料去掉。温 度冲击可能导致基板结构的脱层、损坏电镀孔和可能影响长期可靠性的缺陷。Ni/Au 涂镀,虽然应力较小,但不是所有电路板制造商都有的一种技术。作为对电镀的另一种选择, 许多公司已经找到成功的、有经济优势的和平整的安装表面的方法,这就是有机保护层或在 裸铜上与上助焊剂涂层。 作为阻止裸铜安装座和旁通孔/测试焊盘上氧化增长的一个方法,将一种特殊的保护剂 或阻化剂涂层应用到板上。诸如苯并三唑( Benzotriazole)和咪唑(Imi d azole)这些有机/氮涂层材料被用来取代上面所描述的合金表面涂层,可从几个渠 道购买到,不同的商标名称。在北美洲,广泛使用的一种产品是 ENTEK PLUS CU l06A。这种涂层适合于大多数有机助焊焊接材料,在对装配工艺中经常遇到的三、四 次高温暴露之后仍有保护特征。多次暴露的能力是重要的。当SMD要焊接到装配的主面和 第二面的时候,会发生两次对回流焊接温度的暴露。混合技术典型的多次装配步骤也可能包 括对波峰焊接或其它焊接工艺的暴露。 9、一般成本考虑 与PCB电镀或涂镀有关的成本不总是详细界定的。一些供应商感觉方法之间的成本差 别占总的单位成本中的很小部分,所以界不界定是不重要的。其他的可能对不是其能力之内

高速 PCB 设计指南 - 7 - 焊接有关工艺的暴露。虽然电路导线有阻焊层覆盖，设计者还必须为那些不被阻焊层覆盖的 部分 元件安装座 指定表面涂层。下面的例子是广泛使用在制造工业的合金电镀典型方 法。 通常要求预处理安装座的应用是超密间距ＱＦＰ元件。例如，ＴＡＢ(ｔａｂｌｅ ａｕ ｔｏｍａｔｅｄ ｂｏｎｄ)元件可能具有小于０．２５ｍｍ的引脚间距。通过在这些座上提 供７００－８００μ″的锡／铅合金，装配专家可以上少量的助焊剂、贴装零件和使用加热棒、 热风、激光或软束线光源来回流焊接该元件。在特殊的安装座上选择性地电镀或保留锡／铅 合金将适用于超密间距ＴＡＢ封装的回流焊接。 使用热风均匀法，锡／铅在上阻焊层之后涂镀在电路板上。该工艺是，电镀的板经过清 洗、上助焊剂和浸入熔化的焊锡中，当合金还是液体状态的时候，多余的材料被吹离表面， 留下合金覆盖的表面。热风焊锡均匀 ＨＡＳＬ(ｈｏｔ ａｉｒ ｓｏｌｄｅｒ ｌｅｖｅｌ ｉｎｇ)电镀工艺广泛使用，一般适合于回流焊接装配工艺；可是，焊锡量与平整度的不一 致可能不适合于使用密间距元件的电路板。 密间距的ＳＱＦＰ、ＴＳＯＰ和ＢＧＡ元件要求非常均匀和平整的表面涂层。作为控制 在密间距元件的安装座上均匀锡膏量的方法，表面必须尽可能地平整。为了保证平整度，许 多公司在铜箔上使用镍合金，接着一层很薄的金合金涂层，来去掉氧化物。 在阻焊涂层工艺之后，在暴露的裸铜上使用无电镀镍／金。用这个工艺，制造商通常将 使用锡／铅电镀图案作为抗腐蚀层，在腐蚀之后剥离锡／铅合金，但是不是对暴露的安装座 和孔施用焊锡合金，而是电路板浸镀镍／金合金。 按照ＩＰＣ－２２２１标准《印制板设计的通用标准》，推荐的无电镀镍厚度是２．５ －５．０μｍ(至少１．３μｍ)，而推荐的浸金厚度为０．０８－０．２３μｍ。 有关金的合金与焊接工艺的一句话忠告：如果金涂层厚度超过０．８μｍ（３μ″），那么 金对锡／铅比率可能引起最终焊接点的脆弱。脆弱将造成温度循环中的过分开裂或装配后的 板可能暴露到的其它物理应力。 8、合金电镀替代方案 在上阻焊层之后给板增加焊锡合金是有成本代价的，并且给基板遭受极大的应力条件。 例如用锡／铅涂层，板插入熔化的焊锡中，然后抽出和用强风将多余的锡／铅材料去掉。温 度冲击可能导致基板结构的脱层、损坏电镀孔和可能影响长期可靠性的缺陷。 Ｎｉ／Ａｕ 涂镀，虽然应力较小，但不是所有电路板制造商都有的一种技术。作为对电镀的另一种选择， 许多公司已经找到成功的、有经济优势的和平整的安装表面的方法，这就是有机保护层或在 裸铜上与上助焊剂涂层。 作为阻止裸铜安装座和旁通孔／测试焊盘上氧化增长的一个方法，将一种特殊的保护剂 或阻化剂涂层应用到板上。诸如苯并三唑（Ｂｅｎｚｏｔｒｉａｚｏｌｅ）和咪唑（Ｉｍｉ ｄａｚｏｌｅ）这些有机／氮涂层材料被用来取代上面所描述的合金表面涂层，可从几个渠 道购买到，不同的商标名称。在北美洲，广泛使用的一种产品是ＥＮＴＥＫ ＰＬＵＳ ＣＵ －１０６Ａ。这种涂层适合于大多数有机助焊焊接材料，在对装配工艺中经常遇到的三、四 次高温暴露之后仍有保护特征。多次暴露的能力是重要的。当ＳＭＤ要焊接到装配的主面和 第二面的时候，会发生两次对回流焊接温度的暴露。混合技术典型的多次装配步骤也可能包 括对波峰焊接或其它焊接工艺的暴露。 9、一般成本考虑 与ＰＣＢ电镀或涂镀有关的成本不总是详细界定的。一些供应商感觉方法之间的成本差 别占总的单位成本中的很小部分，所以界不界定是不重要的。其他的可能对不是其能力之内

高速PCB设计指南 的成本有一个额外的费用,因为板必须送出去最后加工。例如,在加州的一家公司将板发送 给在德州的一家公司进行Ni/Au电镀。这个额外处理的费用可能没有清晰地界定为对客 户的一个额外开支;可是,总的板成本受到影响。 每一个电镀和涂镀工艺都有其优点与缺点。设计者与制造工程师必须通过试验或工艺效 率评估仔细地权衡每一个因素。在指定PCB制造是必须考虑的问题都有经济以及工艺上的 平衡。对于细导线、高元件密度或密间距技术与μBGA,平整的外形是必须的。焊盘表面 涂层可以是电镀的或涂敷的,但必须考虑装配工艺与经济性 在所有涂敷和电镀的选择中,Ni/Au是最万能的(只要金的厚度低于5μ")。电镀工 艺比保护性涂层好的优势是货架寿命、永久性地覆盖在那些不暴露到焊接工艺的旁路孔或其 它电路特征的铜上面、和抗污染。虽然表面涂层特性之间的平衡将影响最终选择,但是可行 性与总的PCB成本最可能决定最后的选择。在北美,HASL工艺传统上主宰PCB工业 但是表面的均匀性难于控制。对于密间距元件的焊接,一个受控的装配工艺取决于一个平整 均匀的安装座。密间距元件包括TSoP、SQFP和μBGA元件族。如果密间距元件在 装配中不使用,使用HASL工艺是可行的选择。 10、阻焊层( soldermask)要求 阻焊层在控制回流焊接工艺期间的焊接缺陷中的角色是重要的,PCB设计者应该尽量 减小焊盘特征周围的间隔或空气间隙。虽然许多工艺工程师宁可阻焊层分开板上所有焊盘特 征,但是密间距元件的引脚间隔与焊盘尺寸将要求特殊的考虑。虽然在四边的QFP上不分 区的阻焊层开口或窗口可能是可接受的,但是控制元件引脚之间的锡桥可能更加困难。对于 BGA的阻焊层,许多公司提供一种阻焊层,它不接触焊盘,但是覆盖焊盘之间的任何特征, 以防止锡桥。多数表面贴装的PCB以阻焊层覆盖,但是阻焊层的涂敷,如果厚度大于0.0 4mm(0.0015″),可能影响锡膏的应用。表面贴装PCB,特别是那些使用密间距 元件的,都要求一种低轮廓感光阻焊层。阻焊材料必须通过液体湿工艺或者干薄膜叠层 来使用。干薄膜阻焊材料是以0.07-0.10mm(0.003-0.004″)厚度 供应的,可适合于一些表面贴装产品,但是这种材料不推荐用于密间距应用。很少公司提供 薄到可以满足密间距标准的干薄膜,但是有几家公司可以提供液体感光阻焊材料。通常,阻 焊的开口应该比焊盘大0.15mm(0.006”)。这允许在焊盘所有边上0.07mm (0.003")的间隙。低轮廓的液体感光阻焊材料是经济的,通常指定用于表面贴装应用, 提供精确的特征尺寸和间隙。 结论 密间距(fine- p i t h)、BGA和CSP的装配工艺可以调整到满足可接受的 效率水平,但是弯曲的引脚和锡膏印刷的不持续性经常给装配工艺合格率带来麻烦。虽然使 用小型的密间距元件提供布局的灵活性,但是将很复杂的多层基板报上的元件推得更近,可 能牺牲可测试性和修理。BGA元件的使用已经提供较高的装配工艺合格率和更多的布局灵 活性,提供较紧密的元件间隔与较短的元件之间的电路。一些公司正企图将几个电路功能集 成到一两个多芯片的BGA元件中来释放面积的限制。用户化的或专用的IC可以缓解PC B的栅格限制,但是较高的I/O数与较密的引脚间距一般都会迫使设计者使用更多的电路 层,因此增加PCB制造的复杂性与成本 芯片规模的BGA封装被许多人看作是新一代手持与便携式电子产品空间限制的可行 答案。许多公司也正在期待改进的功能以及更高的性能。当为这些元件选择最有效的接触点 间距时,必须考虑硅芯片模块的尺寸、信号的数量、所要求的电源与接地点和在印制板上采 用这些元件时的实际限制。虽然密间距的芯片规模( c i p scale)与芯片大小的元

高速 PCB 设计指南 - 8 - 的成本有一个额外的费用，因为板必须送出去最后加工。例如，在加州的一家公司将板发送 给在德州的一家公司进行Ｎｉ／Ａｕ电镀。这个额外处理的费用可能没有清晰地界定为对客 户的一个额外开支；可是，总的板成本受到影响。 每一个电镀和涂镀工艺都有其优点与缺点。设计者与制造工程师必须通过试验或工艺效 率评估仔细地权衡每一个因素。在指定ＰＣＢ制造是必须考虑的问题都有经济以及工艺上的 平衡。对于细导线、高元件密度或密间距技术与 μＢＧＡ，平整的外形是必须的。焊盘表面 涂层可以是电镀的或涂敷的，但必须考虑装配工艺与经济性。 在所有涂敷和电镀的选择中，Ｎｉ／Ａｕ是最万能的(只要金的厚度低于５μ″)。电镀工 艺比保护性涂层好的优势是货架寿命、永久性地覆盖在那些不暴露到焊接工艺的旁路孔或其 它电路特征的铜上面、和抗污染。虽然表面涂层特性之间的平衡将影响最终选择，但是可行 性与总的ＰＣＢ成本最可能决定最后的选择。在北美，ＨＡＳＬ工艺传统上主宰ＰＣＢ工业， 但是表面的均匀性难于控制。对于密间距元件的焊接，一个受控的装配工艺取决于一个平整 均匀的安装座。密间距元件包括ＴＳＯＰ、ＳＱＦＰ和 μＢＧＡ元件族。如果密间距元件在 装配中不使用，使用ＨＡＳＬ工艺是可行的选择。 10、阻焊层（sldermask)要求 阻焊层在控制回流焊接工艺期间的焊接缺陷中的角色是重要的，ＰＣＢ设计者应该尽量 减小焊盘特征周围的间隔或空气间隙。虽然许多工艺工程师宁可阻焊层分开板上所有焊盘特 征，但是密间距元件的引脚间隔与焊盘尺寸将要求特殊的考虑。虽然在四边的ＱＦＰ上不分 区的阻焊层开口或窗口可能是可接受的，但是控制元件引脚之间的锡桥可能更加困难。对于 ＢＧＡ的阻焊层，许多公司提供一种阻焊层，它不接触焊盘，但是覆盖焊盘之间的任何特征， 以防止锡桥。多数表面贴装的ＰＣＢ以阻焊层覆盖，但是阻焊层的涂敷，如果厚度大于０．０ ４ｍｍ（０．００１５″），可能影响锡膏的应用。表面贴装ＰＣＢ，特别是那些使用密间距 元件的，都要求一种低轮廓感光阻焊层。阻焊材料必须通过液体 湿 工艺或者干薄膜叠层 来使用。干薄膜阻焊材料是以０．０７－０．１０ｍｍ（０．００３－０．００４″）厚度 供应的，可适合于一些表面贴装产品，但是这种材料不推荐用于密间距应用。很少公司提供 薄到可以满足密间距标准的干薄膜，但是有几家公司可以提供液体感光阻焊材料。通常，阻 焊的开口应该比焊盘大０．１５ｍｍ（０．００６″）。这允许在焊盘所有边上０．０７ｍｍ (０．００３″)的间隙。低轮廓的液体感光阻焊材料是经济的，通常指定用于表面贴装应用， 提供精确的特征尺寸和间隙。 结论 密间距(ｆｉｎｅ－ｐｉｔｃｈ)、ＢＧＡ和ＣＳＰ的装配工艺可以调整到满足可接受的 效率水平，但是弯曲的引脚和锡膏印刷的不持续性经常给装配工艺合格率带来麻烦。虽然使 用小型的密间距元件提供布局的灵活性，但是将很复杂的多层基板报上的元件推得更近，可 能牺牲可测试性和修理。ＢＧＡ元件的使用已经提供较高的装配工艺合格率和更多的布局灵 活性，提供较紧密的元件间隔与较短的元件之间的电路。一些公司正企图将几个电路功能集 成到一两个多芯片的ＢＧＡ元件中来释放面积的限制。用户化的或专用的ＩＣ可以缓解ＰＣ Ｂ的栅格限制，但是较高的Ｉ／Ｏ数与较密的引脚间距一般都会迫使设计者使用更多的电路 层，因此增加ＰＣＢ制造的复杂性与成本。 芯片规模的ＢＧＡ封装被许多人看作是新一代手持与便携式电子产品空间限制的可行 答案。许多公司也正在期待改进的功能以及更高的性能。当为这些元件选择最有效的接触点 间距时，必须考虑硅芯片模块的尺寸、信号的数量、所要求的电源与接地点和在印制板上采 用这些元件时的实际限制。虽然密间距的芯片规模(ｃｈｉｐ ｓｃａｌｅ)与芯片大小的元

高速PCB设计指南 件被看作是新出现的技术,但是主要的元件供应商和几家主要的电子产品制造商己经采用了 一两种CSP的变化类型。在较小封装概念中的这种迅速增长是必须的,它满足产品开发商 对减小产品尺寸、增加功能并且提高性能的需求 第二篇抗干扰3(部分) 3提高敏感器件的抗干扰性能 提高敏感器件的抗干扰性能是指从敏感器件这边考虑尽量减少对干扰噪声 的拾取,以及从不正常状态尽快恢复的方法 提高敏感器件抗干扰性能的常用措施如下: (1)布线时尽量减少回路环的面积,以降低感应噪声。 (2)布线时,电源线和地线要尽量粗。除减小压降外,更重要的是降低耦 合噪声。 (3)对于单片机闲置的IO口,不要悬空,要接地或接电源。其它IC的闲置 端在不改变系统逻辑的情况下接地或接电源 (4)对单片机使用电源监控及看门狗电路,如:IMP809,IMP706,IMP813, Ⅹ25043,X25045等,可大幅度提高整个电路的抗干扰性能。 (5)在速度能满足要求的前提下,尽量降低单片机的晶振和选用低速数字 电路 (6)IC器件尽量直接焊在电路板上,少用IC座。 第三篇印制电路板的可靠性设计-去耦电容配置 在直流电源回路中,负载的变化会引起电源噪声。例如在数字电路中,当电路从一个 状态转换为另一种状态时,就会在电源线上产生一个很大的尖峰电流,形成瞬变的噪声电压。 配置去耦电容可以抑制因负载变化而产生的噪声,是印制电路板的可靠性设计的一种常规做 法,配置原则如下: 电源输入端跨接一个10~100uF的电解电容器,如果印制电路板的位置允许,采用 100uF以上的电解电容器的抗干扰效果会更好。 为每个集成电路芯片配置一个001uF的陶瓷电容器。如遇到印制电路板空间小而装不 下时,可每4~10个芯片配置一个1~10uF钽电解电容器,这种器件的高频阻抗特别小, 在500kHz~20MHz范围内阻抗小于19,而且漏电流很小(0.5uA以下) ·对于噪声能力弱、关断时电流变化大的器件和ROM、RAM等存储型器件,应在芯片 的电源线(Vc)和地线(GND)间直接接入去耦电容。 去耦电容的引线不能过长,特别是高频旁路电容不能带引线

高速 PCB 设计指南 - 9 - 件被看作是新出现的技术，但是主要的元件供应商和几家主要的电子产品制造商已经采用了 一两种ＣＳＰ的变化类型。在较小封装概念中的这种迅速增长是必须的，它满足产品开发商 对减小产品尺寸、增加功能并且提高性能的需求。 第二篇 抗干扰 3（部分） 3 提高敏感器件的抗干扰性能 提高敏感器件的抗干扰性能是指从敏感器件这边考虑尽量减少对干扰噪声 的拾取，以及从不正常状态尽快恢复的方法。 提高敏感器件抗干扰性能的常用措施如下： （1）布线时尽量减少回路环的面积，以降低感应噪声。 （2）布线时，电源线和地线要尽量粗。除减小压降外，更重要的是降低耦 合噪声。 （3）对于单片机闲置的 I/O 口，不要悬空，要接地或接电源。其它 IC 的闲置 端在不改变系统逻辑的情况下接地或接电源。 （4）对单片机使用电源监控及看门狗电路，如：IMP809，IMP706，IMP813， X25043，X25045 等，可大幅度提高整个电路的抗干扰性能。 （5）在速度能满足要求的前提下，尽量降低单片机的晶振和选用低速数字 电路。 （6）IC 器件尽量直接焊在电路板上，少用 IC 座。 第三篇 印制电路板的可靠性设计-去耦电容配置 在直流电源回路中，负载的变化会引起电源噪声。例如在数字电路中，当电路从一个 状态转换为另一种状态时，就会在电源线上产生一个很大的尖峰电流，形成瞬变的噪声电压。 配置去耦电容可以抑制因负载变化而产生的噪声，是印制电路板的可靠性设计的一种常规做 法，配置原则如下： ●电源输入端跨接一个 10～100uF 的电解电容器，如果印制电路板的位置允许，采用 100uF 以上的电解电容器的抗干扰效果会更好。 ●为每个集成电路芯片配置一个 0.01uF 的陶瓷电容器。如遇到印制电路板空间小而装不 下时，可每 4～10 个芯片配置一个 1～10uF 钽电解电容器，这种器件的高频阻抗特别小， 在 500kHz～20MHz 范围内阻抗小于 1Ω，而且漏电流很小（0.5uA 以下）。 ●对于噪声能力弱、关断时电流变化大的器件和 ROM、RAM 等存储型器件，应在芯片 的电源线（Vcc）和地线（GND）间直接接入去耦电容。 ●去耦电容的引线不能过长，特别是高频旁路电容不能带引线

高速PCB设计指南 第四篇电磁兼容性和PCB设计约束(缺具体数据) PCB布线对PCB的电磁兼容性影响很大,为了使PCB上的电路正常工作,应根据本文所 述的约束条件来优化布线以及元器件/接头和某些IC所用去耦电路的布局 (一)、PCB材料的选择 通过合理选择PCB的材料和印刷线路的布线路径,可以做出对其它线路耦合低的传输 线。当传输线导体间的距离d小于同其它相邻导体间的距离时,就能做到更低的耦合,或者 更小的串扰(见《电子工程专辑》2000年第1期应用指南”) 设计之前,可根据下列条件选择最经济的PCB形式: 对EMC的要求 印制板的密集程度 组装与生产的能力 CAD系统能力 设计成本 PCB的数量 电磁屏蔽的成本 当采用非屏蔽外壳产品结构时,尤其要注意产品的整体成本/元器件封装/管脚样式、PCB 形式、电磁场屏蔽、构造和组装),在许多情况下,选好合适的PCB形式可以不必在塑胶外 壳里加入金属屏蔽盒。 为了提高高速模拟电路和所有数字应用的抗扰性同时减少有害辐射,需要用到传输线技 术。根据输出信号的转换情况,SVCC、SⅤEE及ⅤEE-VCC之间的传输线需要表示出来, 如图1所示。 信号电流由电路输出级的对称性决定。对MOS而言IOL=OH而对TIL而言IOL>IOH 功能/逻辑类型ZOΩ) 电源(典型值)<<10 逻辑 T∏L逻辑 HC(T)逻辑 表1:几种信号路径的传输线阻抗ZO。 逻辑器件类型和功能上的原因决定了传输线典型特征阻抗ZO,如表1所示。 图1:显示三种特定传输线的(数字)IC之间典型互联图 图2:IC去耦电路。 图3:正确的去耦电路块 表2:去耦电容Cdec.的推荐值。 逻辑电路噪声容限

高速 PCB 设计指南 - 10 - 第四篇 电磁兼容性和 PCB 设计约束（缺具体数据） PCB 布线对 PCB 的电磁兼容性影响很大，为了使 PCB 上的电路正常工作，应根据本文所 述的约束条件来优化布线以及元器件/接头和某些 IC 所用去耦电路的布局 （一）、PCB 材料的选择 通过合理选择 PCB 的材料和印刷线路的布线路径，可以做出对其它线路耦合低的传输 线。当传输线导体间的距离 d 小于同其它相邻导体间的距离时，就能做到更低的耦合，或者 更小的串扰（见《电子工程专辑》2000 年第 1 期"应用指南"）。 设计之前，可根据下列条件选择最经济的 PCB 形式： 对 EMC 的要求 ·印制板的密集程度 ·组装与生产的能力 ·CAD 系统能力 ·设计成本 ·PCB 的数量 ·电磁屏蔽的成本 当采用非屏蔽外壳产品结构时，尤其要注意产品的整体成本/元器件封装/管脚样式、PCB 形式、电磁场屏蔽、构造和组装），在许多情况下，选好合适的 PCB 形式可以不必在塑胶外 壳里加入金属屏蔽盒。 为了提高高速模拟电路和所有数字应用的抗扰性同时减少有害辐射，需要用到传输线技 术。根据输出信号的转换情况，S-VCC、S-VEE 及 VEE-VCC 之间的传输线需要表示出来， 如图 1 所示。 信号电流由电路输出级的对称性决定。对 MOS 而言 IOL=IOH,而对 TTL 而言 IOL＞IOH. 功能/逻辑类型 ZO(Ω) 电源（典型值） ＜＜10 ECL 逻辑 50 TTL 逻辑 100 HC(T)逻辑 200 表 1：几种信号路径的传输线阻抗 ZO。 逻辑器件类型和功能上的原因决定了传输线典型特征阻抗 ZO，如表 1 所示。 图 1：显示三种特定传输线的（数字）IC 之间典型互联图 图 2：IC 去耦电路。 图 3：正确的去耦电路块 表 2：去耦电容 Cdec..的推荐值。 逻辑电路噪声容限