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中国地质大学(武汉):《单片机原理及应用 Principle and Application of Single Chip Microcomputer》课程教学资源(课件讲稿)第五章 80C51的中断系统及定时计数器

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5.1 80C51的中断系统 5.2 80C51的中断处理过程 5.3 80C51的定时/计数器
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第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 本章分为三节,主要介绍: 5.180C51的中断系统 5.280C51的中断处理过程 5.380C51的定时/计数器 L

本章分为三节,主要介绍: 5.1 80C51的中断系统 5.2 80C51的中断处理过程 5.3 80C51的定时/计数器

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 5.180C51的中断系统 5.1.180C51的中断系统结构 一、中断的概念 CPU在处理某一事件A时,发生了另一事件B请 求CPU迅速去处理(中断发生); CPU暂时中断当前的工作,转去处理事件B(中 断响应和中断服务); 待CPU将事件B处理完毕后,再回到原来事件A被 中断的地方继续处理事件A(中断返回),这一过 程称为中断

5.1 80C51的中断系统 5.1.1 80C51的中断系统结构 一、中断的概念 CPU在处理某一事件A时,发生了另一事件B请 求CPU迅速去处理(中断发生); CPU暂时中断当前的工作,转去处理事件B(中 断响应和中断服务); 待CPU将事件B处理完毕后,再回到原来事件A被 中断的地方继续处理事件A(中断返回),这一过 程称为中断

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 断点 主程序A 响应 返回 : RETI 中断服务程序B 引起CPU中断的根源,称为中断源。中断源向CPU提 出的中断请求。CPU暂时中断原来的事务A,转去处理事 件B。对事件B处理完毕后,再回到原来被中断的地方(即 断点),称为中断返回。实现上述中断功能的部件称为中 断系统(中断机构)。 ④☒以

引起CPU中断的根源,称为中断源。中断源向CPU提 出的中断请求。CPU暂时中断原来的事务A,转去处理事 件B。对事件B处理完毕后,再回到原来被中断的地方(即 断点),称为中断返回。实现上述中断功能的部件称为中 断系统(中断机构)。 主程序A 响应 返回 断点 RETI … … 中断服务程序B

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 随着计算机技术的应用,人们发现中断技 术不仅解决了快速主机与慢速/O设备的数据 传送问题,而且还具有如下优点: ·分时操作。CPU可以分时为多个VO设备服 务,提高了计算机的利用率; 实时响应。CPU能够及时处理应用系统的随 机事件,系统的实时性大大增强: 可靠性高。CPU具有处理设备故障及掉电等 突发性事件能力,从而使系统可靠性提高

随着计算机技术的应用,人们发现中断技 术不仅解决了快速主机与慢速I/O设备的数据 传送问题,而且还具有如下优点: • 分时操作。CPU可以分时为多个I/O设备服 务,提高了计算机的利用率; •实时响应。CPU能够及时处理应用系统的随 机事件,系统的实时性大大增强; •可靠性高。CPU具有处理设备故障及掉电等 突发性事件能力,从而使系统可靠性提高

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 二、80C51中断系统的结构 80C51的中断系统有5个中断源,2个优先级, 可实现二级中断嵌套。 TCON IE IP 硬件查询 INto EA 1 PXO 自然优 高 IEO Q 0 0 0 ETO 1 PTO TO TFO 级 0 中断入口 0 中断源 EX1 1 PX1 1 0 IEl ET1 1 低 Ti TF1 Q 0 Q 0 自然优先 X ES 1 PS RI 级 中断入口 TI 中断源 SCON

二、80C51中断系统的结构 80C51的中断系统有5个中断源,2个优先级, 可实现二级中断嵌套 。 EX0 EA PX0 0 1 ET0 PT0 0 1 EX1 PX1 0 1 ET1 PT1 0 1 ES PS 0 1 ≥1 RI TI SCON TCON IE0 TF0 IE1 TF1 1 0 1 0 1 IT0 IT1 INT0 INT1 T0 T1 RX TX IE IP 1 1 1 1 1 1 1 1 0 硬件查询 自 然 优 先 级 自 然 优 先 级 中断入口 中断入口 高 级 低 级 中断源 中断源

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 5.1.2 80C51的中断源 一、中断源 1、1 NT0(P3.2)。可由IT0(TC0N.0)选择其为 低电平有效还是下降沿有效。当CPU检测到P3.2 引脚上出现有效的中断信号时,中断标志 IE0(TC0N.1)置1,向CPU申请中断。 2、NT1(P3.3)。可由IT1(TC0N.2)选择其为 低电平有效还是下降沿有效。当CPU检测到P3.3 引脚上出现有效的中断信号时,中断标志 IE1(TC0N.3)置1,向CPU申请中断。 ☑I

5.1.2 80C51的中断源 一、中断源 INT0 2、 INT1 (P3.3)。可由IT1(TCON.2)选择其为 低电平有效还是下降沿有效。当CPU检测到P3.3 引脚上出现有效的中断信号时 , 中断标志 IE1(TCON.3)置1,向CPU申请中断。 1、 (P3.2)。可由IT0(TCON.0)选择其为 低电平有效还是下降沿有效。当CPU检测到P3.2 引脚上出现有效的中断信号时 , 中断标志 IE0(TCON.1)置1,向CPU申请中断

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 3、TF0(TC0N.5),片内定时/计数器T0 溢出中断请求标志。当定时/计数器0发生 溢出时,置位TF0,并向CPU申清中断。 4、 TF1(TC0N.7),片内定时/计数器T1 滋出中断请求标志。当定时/计数器1发生 溢田时,置位F1,并向CPU申请中断。 5、 RI(SC0N.0)或TI(SCON.1),串行口 中断请求标志。当串行口接收完一帧串行数 据时置位RI或当串行口发送完一帧串行数据 时置位TI,向CPU申请中断

3、TF0(TCON.5),片内定时/计数器T0 溢出中断请求标志。当定时/计数器T0发生 溢出时,置位TF0,并向CPU申请中断。 4、TF1(TCON.7),片内定时/计数器T1 溢出中断请求标志。当定时/计数器T1发生 溢出时,置位TF1,并向CPU申请中断。 5、RI(SCON.0)或TI(SCON.1),串行口 中断请求标志。当串行口接收完一帧串行数 据时置位RI或当串行口发送完一帧串行数据 时置位TI,向CPU申请中断

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 二、中断请求标志 1、TCON的中断标志 位 60 5 4 30 20 1e 0e 字节地址:88H。 TF1. TR1 TFO TRO IEl. IT1 IEO ITO TCON ITO (TCON.0) ,外部中断0触发方式控制位。 当T0=0时,为电平触发方式。 当T0=1时,为边沿触发方式(下降沿有效)。 IE0(TCON.1),外部中断0中断请求标志位。 IT1(TCON.2),外部中断1触发方式控制位。 IE1(TCON.3),外部中断1中断请求标志位。 TF0(TCON.5),定时/计数器T0溢出中断请求标志位。 TF1(TCON.7),定时/计数器T1溢出中断请求标志位

二、中断请求标志 1、TCON的中断标志 IT0(TCON.0),外部中断0触发方式控制位。 当IT0=0时,为电平触发方式。 当IT0=1时,为边沿触发方式(下降沿有效)。 IE0(TCON.1),外部中断0中断请求标志位。 IT1(TCON.2),外部中断1触发方式控制位。 IE1(TCON.3),外部中断1中断请求标志位。 TF0(TCON.5),定时/计数器T0溢出中断请求标志位。 TF1(TCON.7),定时/计数器T1溢出中断请求标志位

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 2、SCON的中断标志 7 6 5 4 3 23 1e 0 位 字节地址:98H K K> TI RI SCON. RI(SCON.0),串行口接收中断标志位。当允 许串行口接收数据时,每接收完一个串行帧,由 硬件置位RI。同样,RI必须由软件清除。 T1(SCON.1),串行口发送中断标志位。当 CPU将一个发送数据写入串行口发送缓冲器时, 就启动了发送过程。每发送完一个串行帧,由硬 件置位TI。CPU响应中断时,不能自动清除TI, T必须由软件清除

2、SCON的中断标志 •RI(SCON.0),串行口接收中断标志位。当允 许串行口接收数据时,每接收完一个串行帧,由 硬件置位RI。同样,RI必须由软件清除。 •TI(SCON.1),串行口发送中断标志位。当 CPU将一个发送数据写入串行口发送缓冲器时, 就启动了发送过程。每发送完一个串行帧,由硬 件置位TI。CPU响应中断时,不能自动清除TI, TI必须由软件清除

第5章80C51的中断系统及定时/计数器 《单片机原理及应用技术》 5.1.380C51中断的控制 一、中断允许控制 CPU对中断系统所有中断以及某个中断源的开放和屏 蔽是由中断允许寄存器E控制的。 位 60 50 4 30 20 1 0e 字节地址:A8H EA ES ET1. EX1 ETO EXO E EX0(E.0),外部中断0允许位; ET0(E.1),定时/计数器T0中断允许位; EX1(IE.2),外部中断0允许位; ET1(IE.3),定时/计数器T1中断允许位; ES(IE.4),串行口中断允许位; EA(E.7),CPU中断允许(总允许)位。 I☑I

一、中断允许控制 CPU对中断系统所有中断以及某个中断源的开放和屏 蔽是由中断允许寄存器IE控制的。 5.1.3 80C51中断的控制 •EX0(IE.0),外部中断0允许位; •ET0(IE.1),定时/计数器T0中断允许位; •EX1(IE.2),外部中断0允许位; •ET1(IE.3),定时/计数器T1中断允许位; •ES(IE.4),串行口中断允许位; •EA (IE.7), CPU中断允许(总允许)位

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