教材和参考资料 冬教材 -雷绍充，邵志标，梁峰，《超大规模集成电路测试》，电子工业出 版社2008.5 -在线教材网址： >https://www.keledge.com/wrap/details/book?id=193571 ?参考资料 -VLSI Test Principles and Architectures),L.T.Wang,C.W. Wu,and X.Wen,Morgan Kaufmann,2006. Digital Systems Testing and Testable Design>, M.Abramovici,M.A.Breuer,A.D.Friedman,Computer Science Press,1995 Testing of Digital Systems),Niraj,Sandeep Gupta, Cambridge University Press,2003 。软件 VCS,DFT Compiler,TetraMax 2020/9/4 集成电路可测性设计 2
2020/9/4 集成电路可测性设计 2 教材和参考资料 教材 雷绍充，邵志标，梁峰，《超大规模集成电路测试》，电子工业出 版社 2008.5 在线教材网址： https://www.keledge.com/wrap/details/book?id=193571 参考资料 《VLSI Test Principles and Architectures》, L.T. Wang, C.W. Wu, and X. Wen, Morgan Kaufmann, 2006. 《Digital Systems Testing and Testable Design》， M.Abramovici, M.A.Breuer, A.D.Friedman，Computer Science Press，1995 《Testing of Digital Systems》，Niraj，Sandeep Gupta， Cambridge University Press，2003 软件 VCS，DFT Compiler，TetraMax
司外大华花秀教材一黄 超大规模 数字系统测甘 集成电路测试 和可测性设 窗提克那忠标单峰。编酒 TE VLSI TES DESION FOR PRINCIPLES TESTABILITY ARCHITECTU AM LAUND-TERNO WANG CHENO-WEN WUX 鸟独酷 2020/9/4 集成电路可测性设计 3
2020/9/4 集成电路可测性设计 3
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章节安排 1、概述(2学时) 2、电路测试基础(2学时) ÷3、验证、模拟和仿真(4学时) 4、自动测试生成(2学时) 5、专用可测性设计(2学时) ÷6、扫描设计（2-3学时) 。7、边界扫描法(2-3学时) 8、随机测试和伪随机测试（2学时) 主要以教科书为参考 名 9、内建自测试（2-3学时) 增加新的内容 10、电流测试(2学时) 强调实用性 11、存储器测试(2-3学时) 12、SoC测试(2学时) 13、处理器的测试(2) 2020/9/4 集成电路可测性设计 6
2020/9/4 集成电路可测性设计 6 章节安排 1、概述(2学时) 2、电路测试基础（2学时） 3、验证、模拟和仿真（4学时） 4、自动测试生成（2学时） 5、专用可测性设计（2学时） 6、扫描设计（2-3学时） 7、边界扫描法（2-3学时） 8、随机测试和伪随机测试（2学时） 9、内建自测试（2-3学时） 10、电流测试（2学时） 11、存储器测试（2-3学时） 12、SoC测试（2学时） 13、处理器的测试（2） 主要以教科书为参考 增加新的内容 强调实用性
第一章概述 包子件皮女学 1966 University of Electronic Science and Technology of China
第一章 概述
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2020/9/4 集成电路可测性设计 8 什么是DFT？ 为什么DFT？ 怎么DFT？ What Why How
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2020/9/4 集成电路可测性设计 9 基本目的 使学生掌握VLSI系统测试和可测性设计的基本原理 和主要方法； 使学生把握VLSI系统测试和可测性设计的学科前沿 方向； 使学生对EDA系统中有关测试和可测性设计工具有 初步认识和实践体会； DFT是VLSI设计工程师的基本技能； 就职的需求：设计公司很多有DFT的试题和 要求。 百度一下“DFT 招聘”……
一、研究意义
一、研究意义
为什么需要DFT技术？ 冬下面需要了解一些产业背景和拓展的知识 11
下面需要了解一些产业背景和拓展的知识 11 为什么需要DFT技术？
摩尔定律(Moore Law) 集成电路芯性能提高大致符合摩尔定律，即集成电 路单位面积上可容纳的器件数量每年（其后期减慢 为18个月)会增加一倍，而成本却成比例地递减。 目前为止，集成电路的发展仍然符合摩尔定律。 070 12
摩尔定律（Moore Law） 集成电路芯性能提高大致符合摩尔定律，即集成电 路单位面积上可容纳的器件数量每年(其后期减慢 为18个月)会增加一倍，而成本却成比例地递减。 目前为止，集成电路的发展仍然符合摩尔定律。 12